iverilog include file can can tod and dind and模块丢失了

发布于 2025-01-19 10:48:08 字数 445 浏览 1 评论 0原文

我编写makefile来编译我当前的项目。但是找不到testbench中的文件和模块。 错误信息 “在此处输入图像说明” makefile “在此处输入图像说明” 源列表 enter image description here

It will work if I put all the source files in the same directory.下面的命令 “在此处输入图像说明”

I write Makefile to compile my current project. But the including file and module in testbench can't be found.
The error information
enter image description here
makefile
enter image description here
source list
enter image description here

It will work if I put all the source files in the same directory. Command below
enter image description here

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评论(1

樱花坊 2025-01-26 10:48:08

这个问题已通过添加 +incdir

在此处输入图像描述得到解决

This question has been fixed by adding +incdir

enter image description here

~没有更多了~
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